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      Entretien pour Physical Design Engineer

      8 juil. 2026
      Candidat à l'entretien anonyme
      Austin, TX

      Autres retours d’entretien d’embauche pour un poste comme Physical Design Engineer chez Qualcomm

      Entretien pour Physical Design Engineer

      6 oct. 2025
      Employé (anonyme)
      Offre acceptée
      Expérience positive
      Entretien difficile

      Candidature

      Aucune offre
      Expérience positive
      Entretien moyen

      Candidature

      J'ai postulé en ligne. J'ai passé un entretien chez Qualcomm (Austin, TX) en sept. 2025

      Entretien

      One hour and loop with 5 people each round focusing on eache step of physical design flow and cadence tools. I have a thesis on RISC V low voltage pd so they asked about that more

      Questions d'entretien [1]

      Question 1

      EMIR analysis and debugging of STA
      Répondre à cette question

      J'ai passé un entretien chez Qualcomm

      Entretien

      4 interviewers. Basics of physical design /cpu architecture/experience based questions/tcl scripting/timing analysis/block closure /techniques/previous wrk exp/ drc analysis related questions/ tool related questions/ example Based questions “how would you solve this?” Kind of questions

      Questions d'entretien [1]

      Question 1

      Explain the challenges involved in previous tapeout
      Répondre à cette question

      Entretien pour Physical Design Engineer

      4 juin 2025
      Candidat à l'entretien anonyme
      San Diego, CA
      Aucune offre
      Expérience négative
      Entretien difficile

      Candidature

      J'ai passé un entretien chez Qualcomm (San Diego, CA)

      Entretien

      Application via Qualcomm careers or referral. Recruiter may reach out for basic screening: Your background, tools used (ICC2, PrimeTime, RedHawk, etc.) Areas of expertise: floorplanning, CTS, routing, STA, DRC, EMIR, etc. Experience with multi-VDD, ECOs, hierarchical designs, colored flows, etc. Technical Phone Interviews (1–2 rounds) Each round typically lasts 45–60 minutes.

      Questions d'entretien [1]

      Question 1

      Walk me through how you approach floorplanning for a block. How do you handle placement of macros and standard cells around them? What considerations go into designing a power grid? How do you handle multi-VDD domains or level shifters? What are tie-high and tie-low cells and where are they used?
      Répondre à cette question
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